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Hardware Description
Table 2-15. Pin Numbers of JTAG Port Signals
44-pin
TQFP
44-pin
PLCC
84-pin
PLCC
100-pin
TQFP
TDI
TDO
TMS
TCK
1
32
7
26
7
38
13
32
14
71
23
62
4
73
15
62
The ISP algorithm is controlled by the ATMISP software, which is running on the PC.
The four JTAG signals are generated by the LPT port and they are buffered by the ISP
download cable before going into the ATF15xx on the CPLD Development/Programmer
Board. The pinout for the 10-pin JTAG Port Header on the CPLD Development/Pro-
grammer Board is shown in Figure 2-8 and the dimensions of this 10-pin male JTAG
header are shown in Figure 2-9.
Figure 2-8. Pinout Diagram of 10-pin JTAG Port Header (Top-view)
GND
NC
NC
VCC
GND
10
8
6
4
2
9
7
5
3
1
TDI
NC
TMS
TDO
TCK
Figure 2-9. 10-pin Male Header Dimensions
Top V ie w
Side V ie w
0.100
0.100
0.025S q .
0.235
All dimensions are in inches
The pinout of this 10-pin JTAG Port Header is compatible with the Altera ? ByteBlaster,
ByteBlasterMV, and ByteBlaster II cables. In addition, the ATMISP software allows
users to choose either the Atmel CPLD ISP Cable or the ByteBlaster/ByteBlast-
erMV/ByteBlaster II cable to implement ISP.
2.2
2-12
Socket Adapter
Board
Atmel ATF15xx-DK3 CPLD Development/Programmer Socket Adapter Boards
(ATF15xx-DK3-XXXXX) are circuit boards that interface with the Atmel ATF15xx-DK3
CPLD Development/Programmer Board. They are used in conjunction with the
ATF15xx-DK3 CPLD Development/Programmer Board to evaluate/program Atmel
ATF15xx ISP CPLDs with different package types. At press time, there are four Socket
Adapter Boards available for the ATF15xx-DK3 covering the 44-TQFP, 44-PLCC, 84-
ATF15xx-DK3 Development Kit User Guide
3605B–PLD–05/06
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